1) 목적 : 1 bit flip flop을 통해 4 bit flip flop을 VHDL과 logic gate로 설계한다. 이 과정에서 VHDL의 process의 사용법을 익히고, logic gate의 구현과 process로의 구현의 차이점을 비교해 본다.
2) 방법 :
[1-bit flip flop]
(1) 입력이 D, Preset, Clear, Clock이고 출력이 Q, notQ인 1 bit D F/F을 VHDL 언어로 설계한다.
(2) 위와 동일한 입출력을 가진 1 bit D F/F을 logic gate로 설계한다.
(3) 둘의 설계 과정과 결과를 비교해 본다.
[4-bit flip flop]
(4) preset, clear, clock을 입력하고, D가 0에서 3인 벡터를 input으로 Q와 notQ를 output으로 하는 4bit의 D F/F을 1bit F/F를 통해서 만든다.
(5) 설계한 F/F를 결과 값을 출력하여 이해한다.
3. 이론
(1) Latch
EN
SR
100
(no change)
10101101111
(lllegal)
0XX
(no change)
....
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RS 및 D Flip Flop JK 및 T Flip Flop 발표 자료 RS 및 D Flip Flop JK 및 T Flip Flop
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클럭 펄스가 나타..
플립플롭(Flip-Flop) ◎ 플립플롭
대다수 놀리 회로들은 그들의 출력 값들이 현재 상태의 입력뿐만 아니라, 이전 상태의 값에 의해서 그 결과가 결정되는 성격을 갖는다. 이런 성격의 논리 회로들을 순차 회로라고 한다. 순차 회로..
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..
디지털 공학 - 4bit 제곱기 설계 디지털 공학
-4비트 제곱기 설계
1) 블록도
2) 진리치표
입력
출력
ABCD수
Y0
Y1
Y2
Y3
Y4
Y5
Y6
Y7
값0001100011001020001004001130000100190100400010000
16
010150001100
·1
25
0110600100100
36
0111700110..
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Counter
실험목표
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1. JK 플립플롭 제작
코딩module jk(J,K,C,Q,Q_);
input J,K,C;
output Q,Q_;
wir..