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(검색결과 약 6,290개 중 8페이지)
[디지털논리회로] Smart Traffic Light Controller 설계(STLC 설계)
리포트 > 공학/기술    13페이지 
Digital Logic Design Project - Smart Traffic Light Controller - ∙목차 - Specification of STLC - I/O signal description - Block diagram of system - State diagram - Verilog HDL source code - Test pl..
전자기 유도를 이용한 멈추지 않는 팽이
리포트 > 공학/기술    14페이지 
전력기기실험 전자기 유도를 이용한 멈추지 않는 팽이 Contents 설계목표 13 Block Diagram and 관련이론 245 팽이의 회전 원리 회로도 and 회로 전체 동작 원리 작품 사진 6 Trouble Shooting 7 설계일정 and 역..
반가산기및전가산기
리포트 > 공학/기술    3페이지 
실험 5. 반가산기 및 전가산기 1. 목적 (1) 반가산기와 전가산기의 설계를 통해 조합논리회로설계방법을 공부한다. (2) 설계회로의 기능측정 2. 이론 다음과 같은 2진수 2개를 더하는 경우에 대해 고찰해 ..
공학, 기술
전기전자 - 반도체 소자의 제작공정 MEMS
리포트 > 공학/기술    6페이지 
전기전자 - 반도체 소자의 제작공정 MEMS 목 차 #반도체 소자의 제작공정 #MEMS (micro electro mechanical systems) 반도체 소자의 제작공정 1단계 단결정 성장 고순도로 정제된 실리콘 용융액에 SEED 결정을..
Voltage-to-Current 변환회로를 수행
리포트 > 공학/기술    3페이지 
실험 1. 회로 8-1의 Voltage-to-Current 변환회로를 수행하라. 을 1V에서 10V까지 parametric 해석을 하였다. 이 회로는 비반전 전압-전류 변환기(전류귀환 증폭회로)로 이상적인 op amp에서 입력 임피던슨 무한..
공학, 기술
컴퓨터에대한제어함수
리포트 > 공학/기술    7페이지 
<1>프로젝트 설명 :5장에 있는 [표 5-6] <컴퓨터에 대한 제어 함수와 마이크로 연산>에 나타난 연산들을 표시할 수 있는 최소한의 연산들을 골라서 [표 7-1] <마이크로 명 령어의 각 필드에 대한 기호와 이진 코..
공학, 기술
디지털 디자인 - 4비트 parity generator, 5비트 parity checker
리포트 > 공학/기술    7페이지 
디지털 디자인 - 4비트 parity generator, 5비트 parity checker 1.even parity 4bit generator 입력 4비트 뒤에 parity bit를 붙여 1의 개수를 even으로 만든다. (1) 진리표 (2)Boolean funtion P=w⊕x⊕y⊕z (..
[전자공학과] VHDL[VHSIC HardwareDescription Language]에 대하여
리포트 > 공학/기술    10페이지 
VHDL에 대하여 (VHSIC HardwareDescription Language) - 목차 1. VHDL의 뜻 2. VHDL이 만들어진 배경 3. VHDL의 장점 4. VHDL의 단점 5. 하드웨어 디자인과 프로그래밍 언어적 디자인 6. 제품제작에 VHDL이 쓰이..
[디지털 시스템설계] 용어조사
리포트 > 교육학    10페이지 
Verilog-HDL ●베릴로그(Verilog) - HDL 정의 전자공학에서 하드웨어 기술 언어(- 記述 言語, hardware description language)는 전자회로를 정밀하게 기술하는 데 사용하는 컴퓨터 언어이다. 흔히 HDL이라고 ..
전자 - LNA 설계 보고서
리포트 > 공학/기술    16페이지 
졸업캡스톤 최종보고서 LNA 설계 목 차 1. 개요 2. 개발내용 가. 애플리케이션 나. TR선정 다. 바이어스 회로 라. 목표 설계 사양 3. 개발 일정 및 역할 분담 4. 결과 가. 설계 스펙 나. 최종 회로도 다. 결..
전자회로실험 - 부귀환과 기본적인 연산 증폭기 회로
리포트 > 자연과학    5페이지 
전자회로실험 - 부귀환과 기본적인 연산 증폭기 회로 [예비] 1. 실험 목적 - 폐루프 전압 이득 측정하고, 이득-대역폭 곱을 계산, 이득과 대역폭간의 절충점을 알아본다. - 전압-전류 변환기와 전류-전압 변환기..
[Verilog프로그래밍]D래치, 플리플롭, shift register
리포트 > 공학/기술    6페이지 
1. 목적 Verilog의 연속할당문을 사용한 래치 설계 방법과 always 문을 사용한 동작적 모델링 방 법의 래치, 플립플롭 설계 방법을 익히고 이를 간단한 회로설계에 적용한다. 2. 기초지식 - feedback이 있는 da..
[전자회로] Pspice 사용법 및 시뮬레이션 실습
리포트 > 공학/기술    7페이지 
1. 제목 : Pspice 사용법 및 시뮬레이션 실습 2. 목적 전자회로 실험을 위해 필수적인 ORCAD의 Pspice 도구를 이용하는 법을 익혀 간단한 회로설계하고 다음의 시뮬레이션을 시행하고 분석한다. DC sweep, DC..
SL 연구개발 직무 첨삭자소서
서식 > 자기소개서    7페이지 
이와 같이 남들은 쉽사리도전하지 못하는 일에 꿈을 갖고 도전하는 정신이 저와 SL의 공통점이라고 생각하였고 그런 점에서 저는 SL에 가장 적합한 인재라고 생각하였기 때문에 SL에 지원하게 되었습니다. 고객 만..
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[자기소개서] 정보통신(회로설계, 신입) BEST 자기소개서
서식 > 자기소개서    4페이지 
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